Name: Implementierung Einer Hochleistungsfähigen 32-Bit RISC Core Architektur (en Alemán)
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Author: Arrabotu, Chandra Shaker ; Rajani, M. ; Ravi Chandan, D.
ISBN: 9786206245520

portada Implementierung Einer Hochleistungsfähigen 32-Bit RISC Core Architektur (en Alemán)

Implementierung Einer Hochleistungsfähigen 32-Bit RISC Core Architektur (en Alemán)

Formato

Libro Físico

Autor

Chandra Shaker Arrabotu

M. Rajani

D. Ravi Chandan

Editorial

Verlag Unser Wissen

Idioma

Alemán

N° páginas

Encuadernación

Tapa Blanda

Dimensiones

22.9x15.2x0.5 cm

Peso

0.13 kg.

ISBN13

9786206245520

Categorías

Ingeniería electrónica

Implementierung Einer Hochleistungsfähigen 32-Bit RISC Core Architektur (en Alemán)

Chandra Shaker Arrabotu (Autor) · M. Rajani (Autor) · D. Ravi Chandan (Autor) · Verlag Unser Wissen · Tapa Blanda

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Reseña del libro "Implementierung Einer Hochleistungsfähigen 32-Bit RISC Core Architektur (en Alemán)"

In diesem Buch geht es um den Entwurf eines RISC-Prozessors mit Pipelining-Architektur. Das 5-stufige Pipelining wird verwendet, um die Geschwindigkeit der Operation zu verbessern. Die 5 Stufen sind Fetch, Decode, Execute, Memory und Write Back. Der Entwurfsprozess umfasst verschiedene stromsparende Techniken auf architektonischer Ebene, was beweist, dass diese Methoden effizienter sind als Back-End-Techniken zur Reduzierung des Stromverbrauchs. Eingebettete Prozessoren mit geringem Stromverbrauch werden in einer Vielzahl von Anwendungen wie Autos, Telefonen, Digitalkameras, Druckern und anderen Geräten eingesetzt. Der Grund für ihre breite Verwendung ist, dass sie klein sind, daher nicht viel Die-Fläche beanspruchen und kostengünstig herzustellen sind. Eine geringe Leistungsaufnahme hilft, die Wärmeabgabe zu reduzieren, die Batterielebensdauer zu verlängern und die Zuverlässigkeit des Geräts zu erhöhen.