Name: systemverilog for verification (en Inglés)
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Availability: InStock
Author: Spear, Chris
ISBN: 9781441945617

portada systemverilog for verification (en Inglés)

systemverilog for verification (en Inglés)

Formato

Libro Físico

Autor

Chris Spear

Editorial

Springer

Idioma

Inglés

N° páginas

472

Encuadernación

Tapa Blanda

Dimensiones

23.4x15.6x2.4 cm

Peso

0.65 kg.

ISBN

144194561x

ISBN13

9781441945617

N° edición

0002

Categorías

Manufactura asistida por ordenador (cam)
Electrónica: circuitos y componentes
Diseño asistido por ordenador (cad)
Ordenadores personales

systemverilog for verification (en Inglés)

Chris Spear (Autor) · Springer · Tapa Blanda

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Reseña del libro "systemverilog for verification (en Inglés)"

The updated and expanded second edition of this book provides practical information for hardware and software engineers using the SystemVerilog language to verify electronic designs. The author explains methodology concepts for constructing testbenches that are modular and reusable. The book includes extensive coverage of the SystemVerilog 3.1a constructs such as classes, program blocks, randomization, assertions, and functional coverage. It also reviews SystemVerilog 3.0 topics such as interfaces and data types. This second edition contains a new chapter that covers programs and interfaces as well as chapters with updated information on directed testbench and OOP, layered, and random testbench for an ATM switch. This edition also includes a new chapter that covers Interfacing to C and many new and improved examples and explanations.